芯片功耗从28mW降到0.28mW

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低功耗设计前，功耗为27.9mW。

低功耗设计后，功耗为0.285mW，功耗降低98.9%！

（一）低功耗lowper debug

今天给大家介绍下景芯SoC训练营低功耗debug，景芯SoC在低功耗P&R完成后，低功耗静态功耗为2.107mW，下图可以看到Internal Power为1.8mW占据了87%的比例，那么这1.8mW的功耗来自哪里？

小编首先联想到的就是时钟IO，进一步查看报告，可以看到就是IO的Internal功耗。

Summary也可以看到这个时钟IO PAD功耗占据了1.838mW。

按照低功耗的架构设计，U_CRYSTAL_OSC0的时钟应该关闭，且该IO PAD应该关电，那么Voltus功耗分析怎么做呢？欢迎加入景芯SoC全流程设计训练营实战吧。

修改后的功耗为：

如果不采用低功耗设计，芯片待机状态下功耗将是27.9mW，嵌入式设备时不可接受的，景芯SoC的全流程学员会深有体会，低功耗设计的重要性可见一斑！

（二）低功耗low power确认

选中一个power gating domain(shut down domain)的STD CELL作为report对象，domain关电后，report_instance_power，发现其功耗确实为0。是不是很好玩？

具体report办法参见知识星球。

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(一)SoC前端课程，您将学会

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(二)SoC中端课程，您将学会

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• Synthesis逻辑综合(芯片级）
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仅中端一门课程内容就抵得上其他培训机构的4-5门课程。

(三)SoC后端课程，您将学会

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仅后端一门课程内容就抵得上其他培训机构的3-4门课程。

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SoC一键式执行flow

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数字电路中经典设计：多条通信数据Lane Merging设计实现

数字电路中经典设计：多条通信数据Lane Distribution实现

UPF低功耗设计

全芯片UPF低功耗设计(含DFT设计)

景芯SoC训练营培训项目，低功耗设计前，功耗为27.9mW。

低功耗设计后，功耗为0.285mW，功耗降低98.9%！

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